多通道發(fā)射場測試系統(tǒng)設(shè)計

蘇淑靖 韓文革

摘 要： 針對目前發(fā)射場測試儀測試通道單一，設(shè)計并開發(fā)一種多通道發(fā)射場測試系統(tǒng)。系統(tǒng)采用模塊化思想，由變送模塊、采集模塊、主控模塊組成。變送模塊將傳感器的信號變送為4～20 mA的電流信號，由采集模塊采集，然后通過背板與主控模塊進行通信與數(shù)據(jù)傳輸。詳細介紹了采集模塊，以FPGA為核心，采用VHDL編寫邏輯控制程序?qū)?shù)據(jù)采集、讀取過程進行控制，信號調(diào)理電路設(shè)計隔離放大電路與濾波電路。實驗結(jié)果表明，數(shù)據(jù)采集正常，各通道數(shù)據(jù)在測試范圍誤差內(nèi)，滿足系統(tǒng)設(shè)計要求，目前已應(yīng)用于發(fā)射環(huán)境測試系統(tǒng)中。

關(guān)鍵詞： 測試； 多通道； 數(shù)據(jù)采集； FPGA； 隔離放大； 濾波

中圖分類號： TN919?34 文獻標識碼： A 文章編號： 1004?373X（2018）19?0100?04

Abstract： Since the test channel of launching site tester is single， a multi?channel test system for launching site was designed and developed. The system adopting the modular concept is composed of transmission module， acquisition module and main control module. The different signals acquired by the sensor are transferred into 4-20 mA current signal through the transmission module， acquired by acquisition module， and communicated and transmitted through the backboard and main control module. The acquisition module is introduced in detail， and takes FPGA as its core. The VHDL is adopted to compile the logic control program to control the data acquisition and reading process. The isolation amplifying circuit and filtering circuit are designed for the signal conditioning circuit. The experimental results show that the data acquisition of the system is normal， and the data of each channel conforms to the error range of the test， which satisfies the system design requirements and is applied in the launching site test system.

Keywords： test； multi?channel； data acquisition； FPGA； isolation amplifying； filtering

0 引 言

隨著當代技術(shù)的發(fā)展，火箭發(fā)射已成為我國國防、經(jīng)濟的重要組成部分，火箭發(fā)射安全的重要性不言而喻?；鸺l(fā)射環(huán)境測試系統(tǒng)對火箭發(fā)射過程中發(fā)射環(huán)境效應(yīng)引起塔架健康狀況變換及周圍環(huán)境參數(shù)進行測試，測試參數(shù)包括溫度、沖擊、振動和噪聲，為火箭研制總體單位、地面發(fā)射設(shè)備研制單位及航天器發(fā)射場提供發(fā)射近場的發(fā)射效應(yīng)參數(shù)，為分析發(fā)射環(huán)境效應(yīng)對發(fā)射環(huán)境中所處不同位置的設(shè)備產(chǎn)生的危害程度提供依據(jù)， 優(yōu)化和防護火箭本體設(shè)計、地面發(fā)射設(shè)備及發(fā)射場發(fā)射設(shè)施，提高彈、箭發(fā)射試驗的可靠性[1]。

但目前國內(nèi)很多測試系統(tǒng)僅能測試單一參數(shù)，不能同時實現(xiàn)溫度、沖擊、振動、噪聲多個參數(shù)的測試，而且還存在采集傳輸速率低等問題，針對這些問題設(shè)計研發(fā)多通道的火箭發(fā)射環(huán)境測試系統(tǒng)。

1 總體方案設(shè)計

發(fā)射場測試系統(tǒng)由3個模塊組成，分別是變送模塊、采集模塊與主控模塊。變送模塊負責將不同傳感器的信號變送為4～20 mA電流信號；采集模塊采集變送器的電流信號，將其轉(zhuǎn)換成電壓信號并經(jīng)過隔離濾波等信號處理，然后通過A/D轉(zhuǎn)換成數(shù)字信號并存儲到FLASH中；主控模塊通過背板與采集模塊相連并通過USB接口與上位機進行通信與數(shù)據(jù)傳輸[2]。

模塊間連接如圖1所示。

2 硬件設(shè)計方案

2.1 硬件設(shè)計電路框圖

數(shù)據(jù)輸入共64個通道，共4塊電路板，4塊采集板通過背板與主控板連接。每塊電路板16個通道，其中壓力測試6個通道，溫度測試6個通道，沖擊測試2個通道，噪聲測試2個通道。本文主要對采集模塊進行詳細描述，其硬件設(shè)計方案如圖2所示。

本文設(shè)計采用Xilinx XC6SLX100的FPGA芯片作為整個模塊的核心控制器，實現(xiàn)對整個模塊的控制與通信功能，該芯片能夠提供各種業(yè)界領(lǐng)先的連接特性，具有很高的性價比。其主要性能特點是內(nèi)部具有976 Kb的分布式RAM和4 824 Kb的塊RAM，最大用戶I/O引腳為480個，同時支持高速的LVDS接口[3]。

采集模塊將變送器輸出的電流信號經(jīng)電流轉(zhuǎn)電壓芯片RCV420將輸入的4～20 mA電流信號轉(zhuǎn)換成電壓信號，然后通過信號隔離電路模塊ISO122將干擾信號隔離，再通過抗混疊濾波器將帶外信號濾除，濾除的信號在FPGA的控制下經(jīng)模數(shù)轉(zhuǎn)換器AD7699進行轉(zhuǎn)換，轉(zhuǎn)換后的信號存儲到FLASH存儲器中，最后通過計算機控制主控模塊讀取FLASH中的數(shù)據(jù)[4]。

2.2 信號調(diào)理電路的設(shè)計

調(diào)理電路的設(shè)計是十分重要的，能夠提高系統(tǒng)的采樣精度。信號調(diào)理電路包括信號隔離電路以及抗混疊濾波器電路。

2.2.1 信號隔離電路

為了抑制變送器和采集記錄器之間的相互干擾，設(shè)計如圖3所示的信號隔離電路，ISO122是采用滯回調(diào)制解調(diào)技術(shù)設(shè)計的隔離放大器，該電路將輸入信號調(diào)制為500 kHz的方波信號送至輸出端，輸出端再將該調(diào)制信號進行解調(diào)復(fù)現(xiàn)輸入信號。為了抑制電源噪聲，在兩隔離電源與各自的地之間接1 μF鉭電容去耦。為使內(nèi)部500 kHz的震蕩頻率與變換隔離電源的DC/DC變換器的差拍頻率噪聲最小，隔離電源通過Π型濾波后為ISO122供電。為了抑制由內(nèi)部調(diào)制/解調(diào)信號在輸出端形成500 kHz，200 mV的紋波，隔離電路輸出端也進行濾波[5]。

2.2.2 抗混疊濾波器電路

在模數(shù)轉(zhuǎn)換時，被測信號中摻雜的高頻噪聲會等幅度地折疊到低頻有用信號中，這部分噪聲也會被量化。如圖4所示，以頻率[fs]對最大頻率為[fh]的有用信號進行采樣，如果[（fs-fh）～fs]頻段上存在干擾信號，采樣時會將這部分干擾信號以[fs2]為對稱軸等幅度疊加到0～[fh]的有用頻段上，因此要將頻率大于[fs-fh]的噪聲信號濾波，使其至少衰減到ADC的量化電平以下[6]。

火箭發(fā)射環(huán)境測試儀所測試的溫度、振動、沖擊壓力、聲壓4種信號的采樣率分別為1 kS/s，20 kS/s，10 kS/s和20 kS/s。不同的采樣率，如果采用固定截止頻率的濾波器電路，必須設(shè)計不同的外圍電路，增加元器件的種類，降低可靠性。本設(shè)計使用Linear Technology公司生產(chǎn)的開關(guān)電容型濾波器LTC1068，其典型截止頻率誤差僅為±0.3%，截止頻率與輸入時鐘頻率比為1[∶]100，內(nèi)部集成4個獨立二階節(jié)，可以配置成具有各種響應(yīng)（包括Butterworth，Bessel，Chebychev、橢圓、最小[Q]值橢圓和定制響應(yīng)）的低通、高通、帶通、帶阻濾波器，既可以獨立工作又可以兩兩級聯(lián)組成一個4階濾波器，還可以全部級聯(lián)組成8階濾波器[7]。濾波器通帶內(nèi)的幅頻響應(yīng)曲線具有最大平坦度對采集設(shè)備的精度很重要，所以將LTC1068配置成Butterworth模型。[n]階Butterworth幅頻響應(yīng)函數(shù)為：

綜合式（3）～式（6），可得[n≈8]。以上計算依據(jù)的是噪聲幅度最大的情況，而實際環(huán)境下噪聲幅度都比較小，遠遠小于有用信號的幅度，所以要求的衰減值[As]會小于102.35 dB，因此配置抗混疊濾波器為8階濾波器，其電路如圖5所示。

在開關(guān)電容濾波器內(nèi)部，由輸入時鐘控制的MOS開關(guān)高速切換，會對輸出模擬信號產(chǎn)生饋通效應(yīng)，因此在濾波器輸出端也設(shè)計一個RC低通濾波器來最大限度地降低時鐘饋通引入的噪聲[9]。

3 控制與通信邏輯設(shè)計方案

在硬件電路設(shè)計的基礎(chǔ)上，編寫各個模塊的FPGA控制邏輯程序，包括AD7699控制邏輯，F(xiàn)LASH控制邏輯等。

定義采集卡與主控卡的通信協(xié)議和傳輸數(shù)據(jù)的幀結(jié)構(gòu)等，完善測試儀采集卡的下位機邏輯設(shè)計。采集模塊控制和通信功能都由FPGA實現(xiàn)，其內(nèi)部原理圖如圖6所示。

FPGA在接收到時鐘信號后通過下發(fā)命令控制A/D采樣，實現(xiàn)模擬電壓信號的采集，然后通過內(nèi)部FIFO的過渡寫入FLASH；主控模塊通過背板對采集模塊進行控制和數(shù)據(jù)傳輸[10]。

4 試驗結(jié)果與驗證

經(jīng)過多次測試，驗證系統(tǒng)的穩(wěn)定性。圖7是測試系統(tǒng)可靠性時計算機記錄的一段數(shù)據(jù)，被測發(fā)送設(shè)備發(fā)送的自增數(shù)，實線框內(nèi)的“EB+90”為幀頭，“00 01～00 1D”為被測發(fā)送設(shè)備幀計數(shù)標志（為遞增數(shù)），00～1F為接收的自增數(shù)，通過這樣的數(shù)據(jù)標準格式，可以方便地使用計算機分析。

用激光管進行沖擊壓力實驗，如圖8所示，驗證系統(tǒng)的可靠性。前端連接的是傳感器，藍色的是變送器，灰色的是采集記錄儀。

由于通道數(shù)過多，所以只列舉其中一個通道的數(shù)據(jù)。圖9為施加60 kPa壓力時上位機沖擊壓力通道讀取的曲線圖，測量精度為±1 kPa，在誤差范圍內(nèi)。

5 結(jié) 語

本文基于MLVDS的64通道數(shù)據(jù)采集模塊作為火箭發(fā)射環(huán)境測試系統(tǒng)的組成之一，采用模塊化設(shè)計思想，利用FPGA實現(xiàn)數(shù)據(jù)采集傳輸?shù)目刂?，并利用MLVDS接口完成主控模塊與4個采集模塊之間的控制通信與數(shù)據(jù)傳輸。添加CRC校驗碼提高數(shù)據(jù)傳輸?shù)目煽啃裕瑐鬏斔俾蔬_35 MB/s。本模塊已應(yīng)用于火箭發(fā)射環(huán)境測試系統(tǒng)中，數(shù)據(jù)采集正常，誤碼率低，運行效果良好，滿足設(shè)計要求。

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