進化硬件發(fā)展綜述

鮑治國，孫 楠

(河南財經(jīng)政法大學(xué)計算機與信息工程學(xué)院，河南鄭州，450046)

進化硬件發(fā)展綜述

鮑治國，孫 楠

(河南財經(jīng)政法大學(xué)計算機與信息工程學(xué)院，河南鄭州，450046)

進化硬件是進化算法和可編程芯片相結(jié)合的研究熱點。介紹了進化硬件的由來和基本概念，總結(jié)了國內(nèi)外主要研究者的研究成果。分析了進化硬件發(fā)展中面臨的問題，討論了解決對策，展望了發(fā)展前景。

進化硬件；進化算法；數(shù)字電路優(yōu)化設(shè)計

0 引言

從二十世紀(jì)九十年代初，用于硬件設(shè)計的進化硬件（Evolvable Hardware，EHW）[1-6]開始興起了。進化硬件可以分為兩類：電路的進化設(shè)計和自適應(yīng)系統(tǒng)。電路的進化設(shè)計是，用進化算法設(shè)計出符合預(yù)期要求的電路；自適應(yīng)系統(tǒng)是，重構(gòu)現(xiàn)有的系統(tǒng)使其可以容錯或者適應(yīng)環(huán)境的變化。進化硬件技術(shù)可以作為一種替代傳統(tǒng)硬件設(shè)計技術(shù)的選擇。

隨著現(xiàn)場可編程陣列(Field Programmable Gate Array, FPGA)的出現(xiàn)，關(guān)于進化硬件的研究開始火熱了。在許多方面，進化硬件都表現(xiàn)的比較成功和有前景，因為它可以通過進化算法自動的生成電路。通過進化硬件可以產(chǎn)生多種數(shù)字電路，如：加法器，乘法器，神經(jīng)網(wǎng)路，機器控制器，交通信號分類器，數(shù)字圖像濾波器，等。

1 國外發(fā)展?fàn)顩r

1992年，日本學(xué)者Garis H de和瑞士聯(lián)邦工學(xué)院的科學(xué)家們同時提出了將FPGA的結(jié)構(gòu)可重配置特性與進化算法相結(jié)合的方案，標(biāo)志著進化硬件這一新興研究領(lǐng)域的正式誕生[7,8]。1995年10月在瑞士洛桑召開了進化硬件國際專題會議(Towards Evolvable Hardware)。1996年在日本筑波召開了第一屆國際進化系統(tǒng)會議(International Conference on Evolvable Systems，ICES)，1998年在瑞士召開了第二屆ICES會議，2000年在英國召開了第三屆ICES會議。1999年前，硬件進化技術(shù)的研究主要在歐洲和日本。1999年，美國國家航空航天局(NASA)與美國國防部(DoD)成立了進化硬件小組，召開NASA／DoD Conference on Evolvable Hardware(EH)會議；從2006年起，該會議由NASA／ESA Conference on Adaptive Hardware and Systems(AHS)取代，每年舉辦1次。從2007年起，由計算機智能協(xié)會發(fā)起并召開的IEEE WEAH (Workshop on Evolvable and Adaptive Hardware)會議，主要關(guān)注進化硬件的自適應(yīng)性和容錯系統(tǒng)。

目前，美國在EHW理論與應(yīng)用研究方面取得了較大的進展，在這一領(lǐng)域已處于國際領(lǐng)先地位。此外，相關(guān)的國際會議還包 括 Genetic and Evolutionary Computation Conference (GECCO)、IEEE Congress on Evolutionary Computation (CEC)、European Conference on Genetic Programming等。許多國際知名的學(xué)術(shù)刊物對于EHW領(lǐng)域的研究和進展重點進行了刊登和報道，如德國Springer出版社專門用于刊登EHW領(lǐng)域文章的 Genetic Programming and Evolvable Machines、美國 ACM的 ACM Transactions on Design Automation of Electronic Systems、IEEE Transactions on Evolutionary Computation、IEEE Transactions on Systems Man and Cybernetics 等。此外，IEEE Transactions on Computer 于2013年門推出一期特刊 “Adaptive Hardware and Systems”用于EHW領(lǐng)域研究進展與成果的報道。

目前，國際EHW研究領(lǐng)域主要的研究機構(gòu)及其研究成果概述如下。

(1)美國NASA噴氣動力實驗室（JPL)：主要從事模擬電路進化設(shè)計、EHW平臺設(shè)計[9]，致力于未來NASA太空任務(wù)中硬件對于未知環(huán)境（極端溫度和輻射）的容忍和自適應(yīng)能力以及硬件的長時間生命存活能力研究[10,11]。其研究成果不僅提高了EHW的仿真和實驗技術(shù)，更重要的是在芯片級別設(shè)計及實現(xiàn)了一系列晶體管級的模擬和數(shù)字電路。

Stoica等發(fā)表了關(guān)于晶體管級EHW的研究成果[12]并申請了專利（Patent NO:US 6728666 Bl),利用DSP(Digital Signal Process，數(shù)字信號處理)芯片運行遺傳算法作為可重構(gòu)機制控制架在一塊自容式電路板上的EHW平臺，快速可重構(gòu)使得算法在數(shù)秒內(nèi)實現(xiàn)了收斂。進化結(jié)果表明，采用JPL開發(fā)的FPTA-2芯片，通過進化方式硬件電路功能能夠從極端溫度或輻射環(huán)境中恢復(fù)，在230度高溫及250kRad輻射下仍能正常工作。Fernando等在Xilinx Virtex FPGA(Field－Programmable Gate Array，現(xiàn)場可編程門陣列)上構(gòu)造了一個片上實現(xiàn)GA(Genetic Algorithm，遺傳算法)的IP核，不僅能夠?qū)崿F(xiàn)通用的GA引擎，還能根據(jù)種群大小、進化代數(shù)等參數(shù)實現(xiàn)用戶定制功能，具有可編程、占用空間小及低功耗的優(yōu)點[13]。Keymeulen等利用JPL的EHW系統(tǒng)及FPTA(可編程晶體管陣列，F(xiàn)ield Programmable Transistor Array)芯片實現(xiàn)了具有信號分離與噪聲抑制功能電路的在片進化[14]。為了確保在太空的極端溫度條件下電路能夠正常工作，Zebulum等利用EHW對于環(huán)境變化的自適應(yīng)特性，通過電路重構(gòu)保證系統(tǒng)在液氮低溫達-196.6°C及高溫280°C的情況下仍能正常工作[10]。此外，Stoica等首先提出了多態(tài)電路及多態(tài)電子學(xué)的概念并設(shè)計了一系列多態(tài)門，開啟了EHW領(lǐng)域的一個重要發(fā)展方向及應(yīng)用領(lǐng)域[15]。

(2)捷克Bmo科技大學(xué)FIT演化硬件研究小組:主要致力于多態(tài)電路設(shè)計及應(yīng)用、濾波器設(shè)計、多態(tài)芯片設(shè)計等方面的研究[16-18]。

Sekanina于2005年率先將多態(tài)門應(yīng)用于門級多態(tài)電路進化設(shè)計，利用多態(tài)門的功能轉(zhuǎn)換特性實現(xiàn)了硬件電路對于特定環(huán)境變化的自動響應(yīng)[19]，隨后，又將多態(tài)電路應(yīng)用于圖像濾波器設(shè)計[17]及容錯系統(tǒng)設(shè)計中的自動檢測問題[20]。Gajda等通過結(jié)合傳統(tǒng)設(shè)計方法與進化方法進行了多態(tài)電路設(shè)計，提高了設(shè)計方法的可擴展性[18]。Vasicek等針對衛(wèi)星圖像傳輸中常出現(xiàn)的脈沖突發(fā)噪聲（impulse burst noise)，利用擴展形式的笛卡爾遺傳規(guī)劃(Cartesian genetic programming, CGP)減少了進化方法輸入個數(shù)，設(shè)計了一種具有5x5像素濾波窗口的圖像濾波器，其性能優(yōu)于傳統(tǒng)中值濾波器[21]。Vasicek等針對進化方法適應(yīng)度評價時間過長、影響算法可擴展性的問題，利用基于SAT (Satisfiability,可滿足性)的功能等價校驗方法替代原有適應(yīng)度評價方法，將其應(yīng)用于電路后綜合優(yōu)化階段，減少了評價時間及資源消耗[16,22]。FIT演化硬件研究小組于2008年設(shè)計制造了第一款能夠用于小型多態(tài)電路設(shè)計的可重構(gòu)多態(tài)模塊（REP0M032)芯片，實現(xiàn)了多態(tài)電路內(nèi)部進化設(shè)計，為研究多態(tài)電路實際電路特性及應(yīng)用提供了平臺[23]。

(3)日本的ETL:主要將EHW用于模式識別、容錯、圖像壓縮及人工手設(shè)計等方面[24]。

Higuchi等在原有門級電路進化基礎(chǔ)上提出了函數(shù)級電路進化設(shè)計方法，提高了進化設(shè)計方法可擴展性及進化規(guī)模，并利用該方法研究了用于數(shù)字移動通信的自適應(yīng)均衡器及有損數(shù)據(jù)壓縮等[25]。ETL演化系統(tǒng)實驗室設(shè)計了多種EHW芯片用于實際應(yīng)用[26]:在門級電路方面，如用于人工手控制及機器人導(dǎo)航的芯片，用于打印機的數(shù)據(jù)壓縮芯片；在函數(shù)級電路方面，如用于神經(jīng)網(wǎng)絡(luò)自動重構(gòu)的EHW芯片；除了上述三種用于數(shù)字電路進化的芯片外，還研制了用于模擬電路的EHW芯片。如在外部進化模式下，用于移動電話制造的EHW芯片，其生成的電路具有低功耗、低生產(chǎn)成本的特點，以及用于保證高速數(shù)字系統(tǒng)時鐘分配精確度的時鐘延遲調(diào)整芯片。

(4)英國York大學(xué)：主要致力于EHW中進化算法的研究和應(yīng)用。

Miller于2000年提出了后來被廣泛應(yīng)用于數(shù)字電路進化設(shè)計領(lǐng)域的CGP。Walker等在CGP基礎(chǔ)上，借鑒了遺傳規(guī)劃(genetic programming, GP)中的自定義功能（ADF)，通過將相鄰邏輯門裝配成可共享模塊的方法提高了CGP的性能[27]。Harding等提出了自修改笛卡爾遺傳規(guī)劃（SMCGP)用于解決進化設(shè)計方法擴展性問題，隨著電路復(fù)雜度的增加通過表現(xiàn)型電路自動修改完成求解過程[28]。

(5)此外，還有如日本Hugo de garis 領(lǐng)導(dǎo)的 CAM-Brain (Cellular Automata Machines, CAM)項目組[29],英國 Sussex大學(xué)[30],美國 Stanford 大學(xué)[31]等眾多的研究機構(gòu)致力于EHW領(lǐng)域的研究。

2 國內(nèi)發(fā)展現(xiàn)狀

國內(nèi)開展EHW 的研究起步較晚，國內(nèi)少數(shù)單位的研究人員也開始對進化硬件進行研究。國內(nèi)學(xué)者主要集中于研究算法的改進以及采用基于模型的軟件仿真，但是越來越多的研究者開始利用更符合進化硬件研究發(fā)展趨勢的進化技術(shù)或者自行研究適合進化的硬件平臺。

國內(nèi)主要的研究機構(gòu)包括：中國地質(zhì)大學(xué)、深圳大學(xué)、中國科學(xué)技術(shù)大學(xué)，武漢大學(xué)、南京航空航天大學(xué)、西安電子科技大學(xué)等。

中國地質(zhì)大學(xué)（武漢）的康立山教授等研究了三維“人工腦”模型，并提出了以樹型結(jié)構(gòu)函數(shù)可編程器件作為EHW的結(jié)構(gòu)[32]。深圳大學(xué)的朱明程教授等以國家自然科學(xué)基金項目“現(xiàn)場可編程門陣列系統(tǒng)動態(tài)可重構(gòu)技術(shù)的關(guān)鍵問題研究”（編號：NO.69976020)為背景，主要進行FPGA動態(tài)可重構(gòu)技術(shù)及其基礎(chǔ)上的數(shù)字電路系統(tǒng)容錯研究[33]。中國科學(xué)技術(shù)大學(xué)王照法教授等在國家自然科學(xué)基金項目“進化型硬件理論與應(yīng)用研究”（編號：NO. 60404004)的資助下，主要進行EHW中電路進化設(shè)計、進化型SOC及容錯系統(tǒng)研究[34]。武漢大學(xué)李元香教授等承擔(dān)的國家自然科學(xué)基金項目“軟硬件協(xié)同的自主進化技術(shù)及其系統(tǒng)”（編號：NO. 60773009),進行了容錯系統(tǒng)、元胞自動機及進化算法等的研究和應(yīng)用[35,36]。南京航空航天大學(xué)王友仁教授等依托國家自然科學(xué)基金項目“芯片級自修復(fù)數(shù)字系統(tǒng)體系結(jié)構(gòu)與自愈機制研究”（編號：NO. 60871009)，主要進行容錯系統(tǒng)及量子可逆邏輯電路進化設(shè)計的研究[37]。西安電子科技大學(xué)的趙曙光教授等對于進化算法進行了重點研究，將其用于數(shù)字與模擬電路進化設(shè)計，并提出了基于函數(shù)級進化的“最小項編碼”方法[38,39]。

3 進化硬件所面臨的挑戰(zhàn)

作為一個新興的研究領(lǐng)域，進化硬件前景廣闊，但仍面臨著巨大挑戰(zhàn)。數(shù)字電路進化設(shè)計面臨的最大挑戰(zhàn)就是進化方法擴展性問題，主要表現(xiàn)在兩個方面。

3.1 表達擴展性問題

隨著待求解問題復(fù)雜度的提高，實現(xiàn)電路功能所需資源及對其結(jié)構(gòu)進行編碼的染色體長度不斷增加，造成算法搜索空間加大，影響進化方法有效性。

在現(xiàn)有電路編碼方式下，受限于搜索空間，染色體的長度約在幾百位，進化電路仍局限于乘法器等簡單電路。隨著問題越來越復(fù)雜，基因型的長度也隨之增長，伴隨著搜索空間的指數(shù)增長，從而增加了求解問題的難度。目前己有一些文獻致力于解決該問題，概括起來有以下兩個方向：一是研究新的染色體編碼方案和進化算法；二是研究新的電路分解方法。電路編碼方面提出了可變長度的染色體編碼方法(Variable-based Genetic Algorithm，VGA)[40],函數(shù)級的編碼方法[41]以及間接的“基因型一表現(xiàn)型”方法等。在電路分解方面主要有雙向增量進化算法(Bidirectional Incremental Evolution，BIE)[42]和廣義分解析取算法(Generalised Disjunction Decomposition，GDD)等。這些方法從一定程度上緩解了問題，但距離實際應(yīng)用還有不少的差距。

3.2 評價擴展性問題

候選電路適應(yīng)度評價時間隨著輸入輸出個數(shù)的增加呈指數(shù)級別的增長，這也是進化方法設(shè)計復(fù)雜電路的主要瓶頸。

進化算法在搜索最優(yōu)解的過程中的耗時和適應(yīng)度評估時的耗時是影響進化速度的主因。對于復(fù)雜系統(tǒng)，評估時的耗時對進化速度的影響更大。在改進算法執(zhí)行速度方面，軟件上已有基于硬件實現(xiàn)的進化算法[13]和基于并行計算等算法，硬件上圖形處理器(Graphic Processing Unit，GPU)[43]的運用，都加快了進化硬件的執(zhí)行速度，不過并未從根本上解決該問題。

4 結(jié)束語

進化硬件是進化算法和可編程芯片相結(jié)合的研究熱點。本文介紹了進化硬件的由來和基本概念，總結(jié)了國內(nèi)外主要研究者的研究成果。分析了進化硬件發(fā)展中面臨的問題，討論了解決對策，展望了發(fā)展前景。

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A survey of evolvable hardware

Bao Zhiguo, Sun Nan
(College of Computer and Information Engineering, Henan University of Economics and Law,Zhengzhou Henan，450046)

Evolvable hardware is the research focus of evolutionary algorithm and programmable chip. Evolvable hardware is a research hotspot. The origin and basic concept of evolvable hardware are introduced. The main research results of domestic and foreign researchers are summarized. The problems in the development of evolvable hardware are analyzed. The countermeasures are discussed. The development prospects are expected.

evolvable hardware; evolutionary computation; digital circuit optimal design

鮑治國(1977年－),男,博士,講師,研究領(lǐng)域為進化計算,優(yōu)化設(shè)計。孫楠(1983年－),男,碩士,講師，研究領(lǐng)域為軟件工程。

貿(mào)澤備貨Cypress S71KL512SC0 HyperFlash和HyperRAM 功能更強大、表現(xiàn)更出色的多芯片封裝解決方案

河南省科技攻關(guān)項目(No. 162102210274)；鄭州市科技局普通科技攻關(guān)項目(No.153PKJGG116)。

近日，半導(dǎo)體和電子元器件的全球授權(quán)分銷商貿(mào)澤電 子 (Mouser Electronics) 即日起開始分銷Cypress Semiconductor的S71KL512SC0 HyperFlash?和HyperRAM?多芯片封裝 (MCP) 產(chǎn)品。此存儲器子系統(tǒng)解決方案采用小尺寸、低引腳數(shù)封裝，結(jié)合了用于快速引導(dǎo)和即時接通的高速NOR閃存與用于擴展高速暫存器的自刷新DRAM，是空間受限、成本優(yōu)化的嵌入式設(shè)計的理想之選。

貿(mào)澤備貨的 Cypress Semiconductor S71KL512SC0 HyperFlash和 HyperRAM MCP采用Cypress HyperBus?接口，能夠支持更快的系統(tǒng)速度，更短的響應(yīng)時間以及更豐富的用戶體驗。此系列器件具有512Mb HyperFlash和64 Mb HyperRAM，與現(xiàn)有SDRAM和四通道SPI解決方案相比，其引腳數(shù)減少70%，尺寸縮小77%，對于尋求完整高性能存儲器子系統(tǒng)的設(shè)計人員來說，是絕佳的多芯片封裝解決方案。