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    低噪聲DC-DC變換器設(shè)計?

    2016-02-05 10:03:04楊東杰曹燦華甄少偉
    微處理機 2016年6期
    關(guān)鍵詞:調(diào)制器頻譜諧波

    楊東杰,邰 鋒,王 驥,曹燦華,甄少偉,羅 萍,張 波

    (電子科技大學電子薄膜與集成器件國家實驗室,成都610054)

    ·大規(guī)模集成電路設(shè)計、制造與應(yīng)用·

    低噪聲DC-DC變換器設(shè)計?

    楊東杰,邰 鋒,王 驥,曹燦華,甄少偉,羅 萍,張 波

    (電子科技大學電子薄膜與集成器件國家實驗室,成都610054)

    提出了一種基于Sigma-Delta調(diào)制原理的低噪聲DC-DC變換器。首先對比了傳統(tǒng)PWM調(diào)制器型DC-DC變換器及傳統(tǒng)Sigma-Delta調(diào)制器型DC-DC變換器;從它們各自的優(yōu)缺點出發(fā),基于改進的一階Sigma-Delta調(diào)制器,構(gòu)建了新型的DC-DC變換器架構(gòu)。傳統(tǒng)的PWM調(diào)制器被去除,由鐘控量化器實現(xiàn)了調(diào)制功能。環(huán)路補償被簡化,將片外電容及電感組成積分功能模塊,直接用于環(huán)路的構(gòu)成。整體電路基于40nm Mixed-Signal CMOS工藝進行設(shè)計,仿真結(jié)果表明,該結(jié)構(gòu)相比傳統(tǒng)固定頻率PWM調(diào)制DC-DC變換器,輸出電壓頻譜中的諧波尖峰能夠得到有效抑制。在2MHz開關(guān)頻率處,頻譜尖峰減小了40dB,同時具有良好的瞬態(tài)響應(yīng)特性,快速響應(yīng)時間及較小的上下過沖。

    DC-DC變換器;PWM調(diào)制;Sigma-Delta調(diào)制;低噪聲;頻譜抑制;架構(gòu)簡化

    1 引 言

    電源和襯底噪聲對敏感射頻SoC影響巨大,往往會嚴重制約射頻電路的性能。傳統(tǒng)的射頻電路供電一般采用低噪聲、高電源抑制比的低壓差線性穩(wěn)壓器(LDO,Low Dropout Regulator)供電,其具有輸出電壓穩(wěn)定,紋波小,穩(wěn)態(tài)誤差小等特點。但是LDO的效率較低,不利于便攜設(shè)備的長時間待機要求。開關(guān)變換器具有較高的變換效率,但其固定頻率的PWM(PulseWidth Modulation,脈寬調(diào)制)調(diào)制方式會不可避免地引入諧波噪聲,對射頻電路十分不利[1]。Sigma-Delta調(diào)制DC-DC變換器采用Sigma-Delta調(diào)制器替換PWM調(diào)制器,產(chǎn)生不固定頻率的調(diào)制信號輸出,使得以開關(guān)頻率為基波的諧波噪聲得到抑制,輸出電壓頻譜更加平緩,適用于射頻電路的供電,但其調(diào)制器結(jié)構(gòu)復雜,整體功耗增大[2-3]。

    基于Sigma-Delta調(diào)制器的基本原理,提出了一種新型的DC-DC調(diào)制器結(jié)構(gòu),相比較采用傳統(tǒng)PWM調(diào)制器的DC-DC變換器,具有輸出頻譜平滑、結(jié)構(gòu)簡單、面積省、功耗小等優(yōu)點。

    2 DC-DC變換器調(diào)制器

    2.1 PWM調(diào)制Buck變換器

    脈寬調(diào)制模式是指DC-DC變換器保持工作頻率恒定,即工作周期不變,通過改變功率開關(guān)的開啟(或關(guān)閉)時間來改變占空比,從而實現(xiàn)輸出電壓的穩(wěn)定,是目前使用最廣泛的一種調(diào)制模式。

    如圖1(a)所示為常規(guī)電壓控制PWM模式DC-DC變換器。首先對輸出電壓(或經(jīng)過衰減的輸出電壓)和參考電壓進行求差,并將差值傳遞給環(huán)路補償器;補償器輸出的補償信號再經(jīng)過比較器與一個固定頻率的鋸齒波信號相比較,進而產(chǎn)生方波信號;此方波信號的占空比會隨著補償器信號而變化,從而實現(xiàn)脈寬調(diào)制。

    PWM模式DC-DC變換器具有輸出電壓紋波小、變換效率高等優(yōu)點。但是,PWM模式的工作頻率固定,具有周期性的電感電流紋波和輸出電壓紋波,其輸出頻譜具有較高幅度以開關(guān)頻率為基頻的諧波分量,很容易對敏感的模擬或射頻電路形成干擾。不僅如此,這些諧波甚至還可能會通過混頻的方式,將高頻干擾信號調(diào)制到低頻信號上,嚴重影響電路性能[4]。而且,在高集成度的射頻SoC中,由于各子模塊共享低阻襯底,高諧波分量將極大影響接收機靈敏度,甚至造成系統(tǒng)失效[5-6]。

    2.2 傳統(tǒng)Sigma-Delta調(diào)制Buck變換器

    Sigma-Delta調(diào)制技術(shù)憑借其特有的噪聲整形功能,己被廣泛應(yīng)用于數(shù)據(jù)變換器(ADC/DAC)以及頻率綜合器(PLL)的設(shè)計中。

    傳統(tǒng)Sigma-Delta控制Buck DC-DC的系統(tǒng)結(jié)構(gòu)如圖1(b)所示[7],其與PWM控制Buck DCDC系統(tǒng)的差別在于用單比特Sigma-Delta調(diào)制器代替了PWM調(diào)制器。Sigma-Delta調(diào)制器的工作原理與PWM調(diào)制器完全不同,但是它們的目標是一致的,即產(chǎn)生具有相同平均值的占空比信號。只不過PWM調(diào)制器產(chǎn)生的占空比信號具有固定周期,而Sigma-Delta調(diào)制器產(chǎn)生的占空比信號具有隨機周期。

    圖1 系統(tǒng)結(jié)構(gòu)圖

    一階Sigma-Delta調(diào)制器由減法器、積分器和量化器組成,如圖1(b)中的Sigma-Delta調(diào)制器結(jié)構(gòu)所示。它實現(xiàn)了將連續(xù)模擬信號量化為離散數(shù)字信號的功能,其核心思想是噪聲整形,利用了負反饋結(jié)構(gòu),抑制了量化過程中產(chǎn)生的帶內(nèi)量化噪聲,提高信噪比。從時域上看,Sigma-Delta調(diào)制器將輸入連續(xù)信號調(diào)制成一系列高低電平。在一個時鐘周期內(nèi),調(diào)制器要么輸出高電平,要么輸出低電平。當輸入信號較低時,輸出會是較多的低電平,當輸入信號較高時,輸出會是較多的高電平。這樣輸出信號就沒有固定的時鐘周期,從而不會產(chǎn)生與時鐘有關(guān)的諧波成分。相比傳統(tǒng)的PWM調(diào)制DC-DC變換器固定調(diào)制周期的方法[8],Sigma-Delta調(diào)制DCDC的輸出含有的時鐘諧波噪聲要少很多,所以其輸出頻譜更加干凈[9]。但圖1(b)所示Σ-Δ調(diào)制Buck變換器,其Σ-Δ調(diào)制實現(xiàn)方式為簡單替換PWM調(diào)制器,系統(tǒng)較為復雜,且大幅度增加了靜態(tài)功耗和片上面積,不利于在低功耗應(yīng)用中使用[10]。

    3 新型Σ-Δ調(diào)制DC-DC變換器結(jié)構(gòu)

    整體電路結(jié)構(gòu)框圖如圖2所示,其基本結(jié)構(gòu)是一個Buck型DC-DC電路。對比一階Sigma-Delta調(diào)制器的基本結(jié)構(gòu)。電感L和電容C共同組成了積分器結(jié)構(gòu),與比例放大器模塊共同構(gòu)成了一階Sigma-Delta調(diào)制的基本結(jié)構(gòu)。這樣將Sigma-Delta調(diào)制器的結(jié)構(gòu)嵌入了整體DC-DC環(huán)路,而不是采用Σ-Δ調(diào)制器簡單替換PWM調(diào)制器。由于電感L和電容C構(gòu)成的積分電路具有二階低通特性,其具有二階共軛極點,在頻譜上會帶來180度的相位移動,這樣會使整個環(huán)路不穩(wěn)定,所以需要加入相位超前補償模塊,進行頻率補償,使得積分電路具有一階低通特性。同時積分器與量化器的位置相對于一階Sigma-Delta調(diào)制器的結(jié)構(gòu)中二者的位置進行了互換,這樣使得原本輸出為離散信號的Sigma-Delta調(diào)制器結(jié)構(gòu)輸出變?yōu)榱诉B續(xù)的模擬信號。這也是整個環(huán)路與一階Sigma-Delta調(diào)制器結(jié)構(gòu)的不同之處。

    圖2 本設(shè)計DC-DC變換器整體電路結(jié)構(gòu)框圖

    所設(shè)計的DC-DC結(jié)構(gòu)既具有了Sigma-Delta調(diào)制抑制輸出頻譜噪聲的特點,又大大簡化了傳統(tǒng)Sigma-Delta調(diào)制DC-DC變換器的結(jié)構(gòu),減小了功耗和面積。

    如圖3所示,為本設(shè)計中相位超前補償模塊的電路結(jié)構(gòu)圖。運放采用兩級結(jié)構(gòu),提供更高增益的同時,能有效降低非線性引起的帶內(nèi)噪聲。根據(jù)環(huán)路需求,將相位超前補償?shù)牡皖l零點放在與功率LC諧振點相同的位置。

    圖3 本設(shè)計中相位超前補償電路圖

    如圖4所示,本設(shè)計中1bit量化器采用離散比較器結(jié)構(gòu)實現(xiàn)。當CLK為低時,MN1和MN2對輸入信號的差值進行檢測,以產(chǎn)生不同的阻抗;當CLK翻為高后,MN1和MN2的不同阻抗與正反饋回路MN3,MN4,MP2及MP3共同作用,經(jīng)過一級鎖存后產(chǎn)生所需的輸出方波信號。

    圖4 本設(shè)計中量化器電路圖

    4 結(jié)果與討論

    新型低噪聲DC-DC電路在40nm CMOS工藝下進行搭建。在典型供電電壓(VDD=3.3V)和負載(ILoad=0.3A)的情況下進行仿真。在本設(shè)計中,量化器采用了10MHz的采樣時鐘,5倍于變換器開關(guān)頻率(2MHz)。

    DC-DC變換器穩(wěn)態(tài)工作的仿真結(jié)果如圖5所示。輸出電壓紋波在18mV以內(nèi)。功率管開關(guān)信號沒有明顯規(guī)律性,即開關(guān)頻率不固定。

    圖6為負載階躍仿真結(jié)果。負載電流在100mA和600mA之間變化。本設(shè)計DC-DC輸出電壓的瞬態(tài)下、上過沖分別為43mv和28mV。

    圖5 瞬態(tài)仿真輸出結(jié)果

    圖6 負載階躍仿真結(jié)果

    圖7給出了本設(shè)計結(jié)構(gòu)的輸出頻譜特性圖。這里去除了直流DC部分,進行FFT運算,查看輸出電壓的頻譜特性(黑色實曲線圖)。與之對比是傳統(tǒng)PWM調(diào)制DC-DC變換器的頻譜特性(灰色虛曲線圖)。可以看出,本發(fā)明結(jié)構(gòu)的輸出頻譜沒有較高的尖峰噪聲,而傳統(tǒng)PWM調(diào)制DC-DC變換器的輸出存在較高的尖峰噪聲。相比PWM模式DCDC,輸出頻譜在2MHz處對諧波的抑制達到了-40dB。由此看出,本發(fā)明DC-DC結(jié)構(gòu)的輸出頻譜相對于傳統(tǒng)的PWM調(diào)制DC-DC更加平滑,消除了高能量的尖峰噪聲。

    圖7 輸出電壓頻譜特性結(jié)果

    5 結(jié)束語

    新型的DC-DC變換器結(jié)構(gòu)在實現(xiàn)傳統(tǒng)DCDC變換器直流電壓變換功能的同時,改善了PWM調(diào)制DC-DC輸出電壓頻譜噪聲大的缺點,平滑了輸出頻譜特性,抑制了輸出頻譜尖峰噪聲。將Sigma-Delta調(diào)制DC-DC變換器的基本原理嵌入整個DC-DC環(huán)路之中,具備了Sigma-Delta調(diào)制DC-DC輸出噪聲小的特點,同時大大簡化了電路結(jié)構(gòu),減小了面積及功耗。

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    Design of Low-Noise DC-DC Converter

    Yang Dongjie,Tai Feng,Wang Yi,Cao Canhua,Zhen Shaowei,Luo Ping,Zhang Bo
    (State Key Laboratory of Electronic Thin Films and Integrated Devices,University of Electronic Science and Technology of China,Chengdu 610054,China)

    A low-noise DC-DC converter based on Sigma-Delta modulation is proposed.The conventional PWM modulated DC-DC is compared with the conventional Sigma-Deltamodulated DCDC firstly.Improved first-order Sigma-Deltamodulation structure is adopted to build the new DC-DC converter.The conventional PWM modulator is replaced by the clock-controlled quantizer.The loop compensation is simplified.The integrated block which consists of off-chip capacitor and inductor is adopted to form the whole loop.The whole circuit is designed and simulated in a 40nm mixed-signal standard CMOS process and the results show that the frequency harmonic spurs of the output voltage are effectively suppressed comparing to the conventional PWM modulation DC-DC converter.The spurious noise is reduced by 40dB at the switching frequency of 2MHz.Meanwhile,a good transient response characteristic with fast response time and small overshoot is simulated.

    DC-DC converter;PWM modulator;Sigma-Delta modulator;Low-noise;Frequency spectrum suppress;Structure simplified

    10.3969/j.issn.1002-2279.2016.06.001

    TN4

    A

    1002-2279(2016)06-0001-04

    ?申請專利:《一種DC-DC轉(zhuǎn)換器》,中國發(fā)明專利,申請?zhí)枺?01510522230.9《一種具有抑制輸出頻譜諧波噪聲特性的DC-DC轉(zhuǎn)換器》,中國發(fā)明專利,申請?zhí)枺?01510522511.4

    國家自然科學基金青年科學基金(61404025);中央高校基本科研業(yè)務(wù)費項目(ZYGX2014J024)

    楊東杰(1991-),男,四川省樂至縣人,碩士研究生,主研方向:功率模擬集成電路設(shè)計。

    2016-01-14

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